Verilog (2) – 硬體語言的基礎(作者:陳鍾誠) | 台灣精品獎-歷屆得獎名單
![Verilog (2) – 硬體語言的基礎(作者:陳鍾誠)](https://i.imgur.com/DERULla.jpg)
在上一期當中,我們有給出全加器的完整測試程式範例以及執行結果,該範例可以清楚的說明Verilog的閘級(GateLevel)程式之寫法,因此我們就不再重複說明了。
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在本文中、我們將介紹 Verilog 的基本語法,以便讓讀者能很快的進入 Verilog 硬體設計的領域。
基本型態[1]在一般的程式語言當中,資料的最基本型態通常是「位元」(bit),但是在 Verilog 這種「硬體描述語言」當中, 我們必須有「面向硬體」的思考方式,因此最基本的型態從「位元」轉換為「線路」(wire)。
一條線路的可能值,除了 0 與 1 之外,還有可能是未定值 X ,以及高阻抗 Z,如下表所示:
0 低電位 布 林代數中的假值 1 高電位 布 林代數中的真值 Z 高阻抗 三 態緩衝器的輸出,高阻抗斷線 X 未定值 像 是線路未初始化之前,以及有 0,1 兩者衝突的線路值,或者是輸入為 Z 的輸出值其中的 0 對應到低電位、 1 對應到高電位,這是比較容易理解的部分,但是未定值 X 與高阻抗 Z 各代表甚麼意義呢?
對於一條沒有阻抗的線路而言,假如我們在某點對該線路輸出 1, 另一點對該線路輸出 0,那麼這條線路到底應該是 高電位還是低電位呢?
圖、造成未定值 ...
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